74ls160计数器如何设计？
74ls160为十进制同步加法计数器，同步就是要受到时钟信号的控制——清零和置数，附加功能有进位输出端、置数端、清零端，还有置数输入端状态输出及时钟信号端口，其余端口暂可不用。那么根据以上端口可以利用反馈置“ 0”反馈复位)实现。
74160有效循环为0000-1001，由于初态为0000，故六进制为六个状态循环，即0000~0101，置零信号取自0110即当状态0110(6出现时，将Q2=1，Q1=1送到清零端R即Rp= 0.0)，使计数器立即清零， 状态0110仅瞬间存在。
扩展资料
构成任意进制计数器一般的方法
（1）置零法
取Q(N+1)的输出做置零信号，直接复位计数器，Q输出归零的时间滞后于(N+1)的时钟前沿，这种方式浪费了同步计数器的优点，是异步计数器的用法。
（2）置数法
预置输入先置0，取Q(N)的输出做置数信号，在(N+1)的时钟前沿Q输出同步归零，这是完全同步计数，是同步计数器的正确用法。
比较两种方法可知，设计N进制计数器时，清零法的反馈信号是（N+1），控制端是置零CR' ；置数法的反馈信号是 N ，控制端是置数LD' 。
参考资料来源：百度百科-计数器
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