Verilog HDL语言中如果是有符号数怎么定义啊？Parameters定义的数是不是都是无符号数？ 汇编语言中，如何说明一个数是有符号数还是无符号数
verilog \u4e2dreg\u9ed8\u8ba4\u662f\u6709\u7b26\u53f7\u6570\u8fd8\u662f\u65e0\u7b26\u53f7\u6570\u662f\u65e0\u7b26\u53f7\u6570\uff0c\u5b83\u8868\u793a\u5bc4\u5b58\u5668\u7c7b\u578b\u53d8\u91cf\uff0c\u662f\u4e8c\u8fdb\u5236\u7f16\u7801\uff0c\u800c\u4e0d\u662f\u4e00\u4e2a\u591a\u5927\u7684\u6570\u5b57\u3002
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如果你8位数表示-2，可以这样表示
8'h10000010或者8'h11111110
这两种表示方法都可以，但是有一点需要注意，当运算的时候要保证运算结果也是这种形式，并且要正确。如果是第一种表示形式的话-2+（-2），结果仍然8位的话就错了，变成了+4，所以需要进行最高位补偿。但是用补码进行加减运算就不会出错，也不需要补偿，所以建议用第二种表示方法。
现在假设用第二种表示方法来表示有符号数了。那么如果你用parameter这么定义
补充一点：补码表示的时，乘法运算不能直接用"*"来运算，这时或者将补码表示为原码后乘法，然后再将结果转化为补码。或者直接设计一个补码乘法器，用它来完成补码的乘法。
parameter f=8'h11111110
则此时的f表示的便是-2，所以parameter定义的数是有符号数还是无符号数，看你如何表示。
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