74ls148的原理用verilog编程

\u4f18\u5148\u7f16\u7801\u566874LS148\u7684\u5de5\u4f5c\u539f\u7406\u901a\u4fd7\u8be6\u7ec6\u6e05\u695a\u7684\u8bb2\u89e3\uff1f

74ls148\u662f8\u7ebf3\u4e09\u7ebf\u4f18\u5148\u7ea7\u7f16\u7801\u5668\uff0c\u5176\u5f15\u811a\u56fe\u4ee5\u53ca\u5de5\u4f5c\u539f\u7406\u5982\u4e0b\uff1a 74LS48\u662f\u8f93\u51fa\u9ad8\u7535\u5e73\u6709\u6548\u76847\u6bb5\u663e\u793a\u8bd1\u7801\u5668\uff0c\u5176\u5f15\u811a\u56fe\u4ee5\u53ca\u5de5\u4f5c\u539f\u7406\u5982\u4e0b\uff1a

\u5f15\u811a: 1---*4 2---*5 3---*6 4---*7 5---*EN 6---*C 7--*D 8---VSS
9---*A 10---*B 11---*1 12---*2 13---*3 14---*OS 15---*EO 16---VDD
\u771f\u503c\u8868:
*EN *0 *1 *2 *3 *4 *5 *6 *7 *C *B *A *OS *EO
0 0 1 1 1 1 1 1 1 1 1 1 0 1
0 - 0 1 1 1 1 1 1 1 1 0 0 1
0 - - 0 1 1 1 1 1 1 0 1 0 1
0 - - - 0 1 1 1 1 1 0 0 0 1
0 - - - - 0 1 1 1 0 1 1 0 1
0 - - - - - 0 1 1 0 1 0 0 1
0 - - - - - - 0 1 0 0 1 0 1
0 - - - - - - - 0 0 0 0 0 1
0 1 1 1 1 1 1 1 1 1 1 1 1 0
1 - - - - - - - - 1 1 1 1 1
\u6ce8: *OS ,*EO ,\u4e3a\u589e\u52a0\u4f4d\u6570\u65f6\u7684\u7ea7\u8054\u7aef.

altera的芯片：只需要用if_else语句体现出优先级即可。

always @ (posedge clk)
begin
if(rst_n)

q <= 0;
else if(条件A成立)

q <= 条件A；

else if（条件B成立）

q <= 条件B；

end

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