74ls192逻辑功能 数电学的不好，想知道下 数电问题！！！！！！ 74LS192D计数器

74LS192\u51fa\u73b0\u7684\u95ee\u9898

\u5404\u4e2a\u63a7\u5236\u7aef\u53e3\u7684\u7535\u538b\u662f\u4e0d\u662f\u4e5f\u8bbe\u7f6e\u6b63\u786e\u4e86\uff1f\uff1f\uff1f\u6839\u636e\u539f\u4ef6\u8bf4\u660e\u8fde\u63a5\u7535\u8def

UP\u662f\u6b63\u5411\u8ba1\u6570\uff08\u52a0\u6570\u8ba1\u6570\uff09\u63a7\u5236\u7aef\uff0cDOWN\u662f\u53cd\u5411\u8ba1\u6570\uff08\u51cf\u6570\u8ba1\u6570\uff09\u63a7\u5236\u7aef\uff0c\u5b83\u4eec\u90fd\u662f\u9ad8\u7535\u5e73\u6709\u6548\u3002

74LS192是属8421BCD码的十进制计数器，其功能真值表如表4所示。其中MR是异步清零端，高电平有效。PL(———)是并行置数端，低电平有效，且在MR=0有效。CPU和CPu是两个时钟脉冲，当CPd=1，时钟脉冲由CPU端接入。并且MR=0，PL(———)=1时，74LS192处于加法计数状态；当CPu脉冲从CPd端输入，且MR=0，PL(———)=1时，74LS192处于减法计数状态；CPd=CPu=1时，计数器处于保持状态。TCu是进位端，TCd是借位端。
表4 74LS192功能真值表
MR PL(———)
CPu CPd P3 P2 P1 P0 Q3x+1 Q2x+1 Q1x+1
1 × × × × × × × 0 0 0
0 1 × ↑ d3 d2 d1 d0 d3 d2 d1
0 1 ↑ 1 × × × × 加法计数
0 1 1 ↑ × × × × 减法计数
0 1 1 1 × × × × 保持

74192的工作原理是：当LD(———)=1，MR=0时，若时钟脉冲加到CPu端，且CPd =1
则计数器在预置数的基础上完成加计数功能，当加计数到9时，TCu端发出进位下跳变脉冲；若时钟脉冲加到CPd端，且CPu =1，则计数器在预置数的基础上完成减计数功能，当减计数到0时，TCd 端发出借位下跳变脉冲。
74LS192具有下述功能：
①异步清零：MR=1，Q3Q2Q1Q0=0000
②异步置数：MR=0，PL(———)=0，Q3Q2Q1Q0=P3P2P1P0
③保持： MR=0，PL(———)=1，CPu=CPd=1,Q3Q2Q1Q0保持原态
④加计数：MR=0, PL(———)=1，CPu=CP，CPd=1，Q3Q2Q1Q0按加法规律计数
⑤减计数：MR=0, PL(———)=1，CPu=1，CPd= CP，Q3Q2Q1Q0按减法规律计数

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