verilog 中取非和取反有什么区别,为什么要用两种符号 在C语言中~和!在取非时的区别

verilog \u4e2d\u53d6\u975e\u548c\u53d6\u53cd\u6709\u4ec0\u4e48\u533a\u522b\uff0c\u4e3a\u4ec0\u4e48\u8981\u7528\u4e24\u79cd\u7b26\u53f7

\u6c42\u975e\u662f\u903b\u8f91\u8fd0\u7b97\uff0c\u662f\u5e03\u5c14\u503c\uff0c\u53ea\u67091\u4f4d
\u53d6\u53cd\u662f\u4f4d\u8fd0\u7b97\uff0c\u64cd\u4f5c\u6570\u53ef\u4ee5\u662f\u591a\u4f4d

\u4e00\u3001\u8fd0\u7b97\u987a\u5e8f\u4e0d\u540c
1\u3001~\uff1a\u4f4d\u8fd0\u7b97\u7b26\uff0c\u662f\u5bf9x\uff0cy\u8fdb\u884c\u4f4d\u8fd0\u7b97\uff0cx\uff0cy\u53d6\u503c\u5982\u4e0a\uff0c\u90a3\u4e48\u6709x&y=0\uff1b
2\u3001!\uff1a\u662f\u903b\u8f91\u8fd0\u7b97\u7b26\uff0c\u7528\u4e8e\u4ece\u5de6\u5230\u53f3\u6c42\u8868\u8fbe\u5f0f\u7684\u771f\u503c\u3002
\u4e8c\u3001\u8fd0\u7b97\u65b9\u5f0f\u4e0d\u540c
1\u3001~\uff1a \u4f4d\u8fd0\u7b97\u7684\u8fd0\u7b97\u901f\u5ea6\u901a\u5e38\u4e0e\u52a0\u6cd5\u8fd0\u7b97\u76f8\u540c\u3002
2\u3001!\uff1a\u903b\u8f91\u8fd0\u7b97\u7b26\u7528\u4e8e\u5bf9\u5305\u542b\u5173\u7cfb\u8fd0\u7b97\u7b26\u7684\u8868\u8fbe\u5f0f\u8fdb\u884c\u5408\u5e76\u6216\u53d6\u975e\u3002


\u4e09\u3001\u8fd0\u7b97\u8fc7\u7a0b\u4e0d\u540c
1\u3001~\uff1a\u4f4d\u8fd0\u7b97\u7b26\u5c06\u6570\u5b57\u89c6\u4e3a\u4e8c\u8fdb\u5236\u503c,\u5e76\u6309\u4f4d\u8fdb\u884c\u76f8\u5e94\u8fd0\u7b97,\u8fd0\u7b97\u5b8c\u6210\u540e\u518d\u91cd\u65b0\u8f6c\u6362\u4e3a\u6570\u5b57\u3002
2\u3001!\uff1a\u4f7f\u7528\u903b\u8f91\u8fd0\u7b97\u7b26\u7684\u8868\u8fbe\u5f0f,\u8fd4\u56de0\u8868\u793a\u201d\u5047\u201d,\u8fd4\u56de1\u8868\u793a \u201d\u201c\u771f\u201d \u3002
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Verilog中取非用 !，取反用~。
取非 ! 表示运算结果只有0(假)与1(真)两种情况；
取反~表示按位取反，结果有多种。

举例如下：
对于无符号数值13，其二进制为：1101
取非运算： !13=0(因为13不为0为真，所以取非后为假)
取反运算： !13=!1101=0010=2(对每个二进制位进行取反)

请查阅Verilog2001语法规范40页
【1】! 意思是Logical negation，逻辑取反。
【2】~ 意思是 Bit-wise negation，按bit取反。
从字面上，你就能知道他们的差别

欢迎采纳

取非——逻辑运算
取反——位运算

一个用来判断 一个用.....懂~

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