用74138实现全加器
答：故74138的连接图为：下面的地址输入端：A2、A1、A0分别接全加器的三个输入信号：Ai、Bi、Ci－1；下面的使能信号端：S1接高电平＂1＂，S2、S3接低电平＂0＂；上面的信号输出端：Y1、Y2、Y4、Y7接至一个四输入与非门的四个输入端，此与非门的输出端为全加器输出信号Si端；Y3、Y5、Y6、Y7...
答：是采用74138译码器实现的全加器和全减器电路更简单，一片译码器加一片74LS20(即二-4输入与非门)就可以完成。与3-8译码器比较，3-8译码器有3个数据输入端：A,B,C；3个使能端；8个输出端，OUT（0-7）。这里可以把3-8译码器的3个数据输入端当做全加器的3个输入端，即3-8译码器的输入A、...
答：用3线—8线译码器(74LS138芯片)四输入与非门实现三个开关控制一个灯的电路：全加器真值表：00000；00110；01010；01101；10010；10101；11001；11111。故有Si和Ci的表达式分别为：Si＝A’B’C＋A’BC’＋AB’C’＋ABC Ci＝A’BC＋AB’C＋ABC’＋ABC 故74138的连接图为：下面的地址输入端：A2...
答：首先得弄清楚全加器的原理，你这里说的应该是设计1位的全加器。全加器有3个输入端：a,b,ci；有2个输出端：s,co.与3-8译码器比较，3-8译码器有3个数据输入端：A,B,C；3个使能端；8个输出端，OUT（0-7）。这里可以把3-8译码器的3个数据输入端当做全加器的3个输入端，即3-8译码器的...
答：A B Ci C0 S A B Ci C0 S 0 0 0 0 0 1 0 0 0 1 0 0 1 0 1 1 0 1 1 0 0 1 0 0 1 1 1 0 1 0 0 1 1 1 0 1 1 1 0 1
答：工大的孩纸乃们伤不起啊，楼上的同握爪……
答：全加器真值表：00000；00110；01010；01101；10010；10101；11001；11111；故有Si和Ci的表达式分别为：Si＝A’B’C＋A’BC’＋AB’C’＋ABCCi＝A’BC＋AB’C＋ABC’＋ABC故74138的连接图为：下面的地址输入端：A2、A1、A0分别接全加器的三个输入信号：Ai、Bi、Ci－1；下面的使能信号端：S1接...
答：74HC138是高速硅栅CMOS解码器，适合内存地址解码或数据路由应用。74HC138作用原理于高性能的存贮译码或要求传输延迟时间短的数据传输系统，在高性能存贮器系统中，用这种译码器可以提高译码系统的效率。将快速赋能电路用于高速存贮器时，译码器的延迟时间和存贮器的赋能时间通常小于存贮器的典型存取时间，这就是...
答：A B Ci C0 S A B Ci C0 S 0 0 0 0 0 1 0 0 0 1 0 0 1 0 1 1 0 1 1 0 0 1 0 0 1 1 1 0 1 0 0 1 1 1 0 1 1 1 0 1
答：2013-11-11 数字电路与逻辑设计:用74138实现一位全加器!! 338 2014-12-11 用一篇3线~8先译码器74LS138和基本逻辑电路构成一位全... 81 2009-04-20 用74ls138设计一个全加器 54 2018-12-07 用74283四位二进制全加器设计一个2位二进制数(AB)的3... 3 2018-11-04 如何用给定芯片实现组合...
网友评论：
弓牵19553924393：
什么是一位全加器,怎么设计逻辑电路图 -
56904东蓝
： 全加器英语名称为full-adder,是用门电路实现两个二进制数相加并求出和的组合线路,称为一位全加器. 一位全加器可以处理低位进位,并输出本位加法进位.多个一位全加器进行级联可以得到多位全加器.常用二进制四位全加器74LS283. ...
弓牵19553924393：
用译码器74138和与非门设计一位全加器和全减器(用异或门和与非门),设置一控制变量M,用来控制作家非或减法,画出真值表和电路图,最好有卡诺图 -
56904东蓝
： y
弓牵19553924393：
74h138实现一位全加器? 在线等,急求!要电路图,不要原理的 -
56904东蓝
： 先纠正一下,不是74H138,没有这个型号的器件,应该是74HC138(3-8译码器). 单用一片74HC138无法实现全加器功能,还要加一片双通道的4输入与非门(74HC20).实用电路如下图——
弓牵19553924393：
怎样利用74HC153数据选择器实现全加器?由于刚学,不懂,哪位大侠解决一下?紧急. -
56904东蓝
： 将地址输入端(两块公用)A1、A0分别接两个要相加的数A、B,第一块的数据端D3、D0接低位进位信号Ci-1,D2、D1接低位进位信号Ci-1的反变量.第二块的数据端D3接1、D1、D2接低位进位信号Ci-1,D0接0即可.
弓牵19553924393：
试用74HC138实现一位“全加器”电路 -
56904东蓝
： 分别用ABC表示 两个加法位与一个进位写真值表 ABC HL 000 00 001 01 010 01 011 10 100 01 101 10 110 10 111 11 H= O3+O5+O6+O7 L= O1+O2+O4+O7 H为加法结果高位L为低位 这样用一个138加点或门就行了
弓牵19553924393：
如何用3/8线译码器74LS138完成全加器的功能 -
56904东蓝
： 首先得弄清楚全加器的原理,你这里说的应该是设计1位的全加器. 全加器有3个输入端:a,b,ci;有2个输出端:s,co. 与3-8译码器比较,3-8译码器有3个数据输入端:A,B,C;3个使能端;8个输出端,OUT(0-7). 这里可以把3-8译码器的3个数据...
弓牵19553924393：
用74ls138设计一个全加器 -
56904东蓝
： Y4.Y5.Y7 ___________ — — — — Ci=Y3.Y6设A为加数B为被加数 低位进位为Ci-1 和为S 进位为Ci A B Ci-1 S Ci 0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 1 1 1 0 0 1 0 1 0 1 0 1 1 1 0 0 1 1 1 1 1 1 ___________ — — — — S=Y1.Y2
弓牵19553924393：
如何用74HC138实现一位“全加器”电路 -
56904东蓝
： 只能从网上找到这些资料了,别的就不懂了 一位全加器(FA)的逻辑表达式为: Fi=Ai⊕Bi⊕Ci Ci+1=AiBi+BiCi+CiAi 如果将全加器的输入置换成Ai和Bi的组合函数Xi和Yi(S0…S3控制),然后再将Xi,Yi和进位数通过全加器进行全加,就是ALU的逻辑结构结构. 即 Xi=f(Ai,Bi) Yi=f(Ai,Bi) 不同的控制参数可以得到不同的组合函数,因而能够实现多种算术运算和逻辑运算.
弓牵19553924393：
求:用74283全加器设计实现两个四位二进制码的数值比较电路 -
56904东蓝
： 设计思路如下: 将74283接成减法器,见下图.设两个四位二进制码分别为A和B,这里将A设成被减数,B设成减数,S为结果(差). 减法采用补码运算,即A减B等于A加B的补码.四位二进制数A直接接到74283的A1~A4输入端. 按照补码的运算规则,反码加一即为补码,所以四位二进制数B先通过四个反相器求反,然后接到74283的B1~B4输入端,同时74283的C0(进位输入端)接高电平,实现反码加一功能. 输出有两种,可以只用Co来指示A是大于等于B还是小于B,也可以如图中将S1~S4接到一个四输入或门产生A与B是否相等的指示信号,如果没这个要求,则四输入或门可以不用..
弓牵19553924393：
求用两片74ls138设计一个全加器的电路图?? -
56904东蓝
： 不用两片74LS138呀,只用一片74LS138和一片74LS20就能搞定了.
