74ls48真值表
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答:有一位数据显示不出来,是不是几位都是那个数字显示不出来,如果都显示不出来那就可能是因为数码管对应的数据有误或者驱动那段数码管的线有连接问题(段选没选上),如果只有一个显示不出来那个数字那就可能是那段连线的位选线连接或者位选数据有问题(位选没选上),如果确认都没问题那就是坏了.还有你那个...
答:上面提到,74LS48是输出高电平有效的中规模集成BCD七段显示译码驱动器,它的功能简图和管脚引线图如图5-4所示。其真值表见表5-2所示。 表5-2 74LS48BCD七段译码驱动器真值表十进制数或功能 输 入 输 出 A3 A2 A1 A0 a b c d e f g0 1 1 0 0 0 0 1 1 1 1 1 1 1 01 1 × 0 0 0 ...
答:上面提到,74LS48是输出高电平有效的中规模集成BCD七段显示译码驱动器,它的功能简图和管脚引线图如图5-4所示。其真值表见表5-2所示。 表5-2 74LS48BCD七段译码驱动器真值表 十进制数或功能 输入输出 A3 A2 A1 A0 a b c d e f g 0 1 1 0 0 0 0 1 1 1 1 1 1 1 0 1 1 × 0 0 0 1...
答:74ls48除了用74LS248代替,还可用CD4511代替。CD4511的引脚排列和74LS48一样。只差第5脚的电位。74ls48的5脚在真值表上无要求。CD4511的第5脚在0时选通,1时锁存。
网友评论:
茅是18236862777:
组合逻辑电路
34881庾背
: 74LS147:***可以这样:147有9个输入和4个输出,某个输入为0,代表输入某个十进制数,输出端输出相应BCD码,如1脚(I 4)为低电平,那么进行的就是对十进制数4的编码.如果9个输入端都为1(就是任何没有输入),那么进行的就是对十进制数0的编码.(这个器件是低电平有效的器件) ****I 9最高,I 1最低赛... 74LS48:LT(3脚)--高电平1,BI/RBO(4脚)--高电平1,,3脚接低电平时可以显示整个7段(也就是显示8)..用于测试器件是否是好的..
茅是18236862777:
中规模计数器集成电路74ls160 rco在什么状态下出现?其有效电平是什么 -
34881庾背
: 74LS48 的管脚排列如图 (c) 所示. 其真值表如表 3 所示. 该器件输入信号为 BCD 码, 输出端为 a 、 b 、 c 、 d 、 e 、 f 、 g 共 7 线,另有 3 条控制线 LE 、 RBI 、 BI/RBO . LE 端 为测试端.在 BI 端接高电平的条件下,当 LE =0 时,无...
茅是18236862777:
在译码电路中,74LS48的输出端与数码管连接时,要注意什么? -
34881庾背
: 74LS48的有效输出是高电平,因此当它直接连接数码管应用时,只能用于共阴极数码管,如果和共阳极数码管共用,则需要增加反相电路.
茅是18236862777:
74ls48可以用什么代替 -
34881庾背
: 74ls46,74ls47,74ls141等都可以
茅是18236862777:
有关74ls48 -
34881庾背
: 需要在七段数码管的七个端口都加电阻(如560欧姆),如果是共阴极数码管,则电阻另一端接高电平.如果是共阳极数码管,则电阻另一端接低电平.由于74LS48输出高电平有效,所以选前一种情况. 注:七段数码管是共阴极还是共阳极需要看它端口,如果有CK则是共阴极,CK端接地.如果有CA则是共阳极,CA端接高电平.
茅是18236862777:
74LS48与74LS248功能是一样的吗??可以 互相代替吗?? -
34881庾背
: 数字电路中经常需要十六进制七段数码管译码驱动芯片.已知的74LS48、74LS248等芯片由于只是BCD码-七段数码管驱动器,都不能正确显示十六 进制A~F,如用门电路设计,虽然理论上可行,但所需芯片太多,接线过于复杂,而用存储器实现却很方便,并可自由选择共阴或共阳译码输出.限于篇幅,略去 2764作为十六进制七段数码管译码驱动器(包括 74LS48)的真值表.
茅是18236862777:
74ls48除了用74LS248代替,还可以可以用什么型号的芯片代替 -
34881庾背
: 74ls48除了用74LS248代替,还可用CD4511代替.CD4511的引脚排列和74LS48一样.只差第5脚的电位.74ls48的5脚在真值表上无要求.CD4511的第5脚在0时选通,1时锁存.
茅是18236862777:
组合逻辑电路的分析 -
34881庾背
: 在asic设计和pld设计中组合逻辑电路设计的最简化是很重要的,在设计时常要求用最少的逻辑门或导线实现.在asic设计和pld设计中需要处理大量的约束项,值为1或0的项却是有限的,提出组合逻辑电路设计的一种新方法. 与逻辑表示只有在决定事物结果的全部条件具备时,结果才发生.输出变量为1的某个组合的所有因子的与表示输出变量为1的这个组合出现、所有输出变量为0的组合均不出现,因而可以表示输出变量为1的这个组合. 组合逻辑电路的分析分以下几个步骤: (1)有给定的逻辑电路图,写出输出端的逻辑表达式; (2)列出真值表; (3)通过真值表概括出逻辑功能,看原电路是不是最理想,若不是,则对其进行改进.
茅是18236862777:
双2 - 4译码器 74LS139真值表 -
34881庾背
: 4、5、7上的非的意思是:输出低电平有效,即输出逻辑“0”.允许端为“L”时,4个输出端会有1个输出“L”,即“低电平”,或逻辑“0”.允许端为“H”时,4个输出端会全部输出“H”,即“高电平”,或逻辑“1”,视为无效.下图为真值表
茅是18236862777:
74LS48能用seg指令控制吗 -
34881庾背
: 可以. 两者工作原理相似,都是BCD码转为数字源码的译码芯片. 不过,需要注意的是74LS48输出电压电流都比74LS47大,如果不是驱动很大的数码管的话,直接替换是可以的,如果电压较高,电流较大时,可以在74LS47的输出引脚上接一个三极管,进行扩压扩流,就可以了. 74LS47译码器原理: 译码为编码的逆过程.它将编码时赋予代码的含义“翻译”过来.实现译码的逻辑电路成为译码器.译码器输出与输入代码有唯一的对应关系.74LS47是输出低电平有效的七段字形译码器,它在这里与数码管配合使用,表2列出了74LS47的真值表,表示出了它与数码管之间的关系.